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南京信息工程大學(xué)2019考研大綱：F17數(shù)字電路
科目代碼：F17
科目名稱：數(shù)字電路
第一部分 考試形式和試卷結(jié)構(gòu)彰武
一、試卷滿分及考試時(shí)間
試卷滿分為150分，考試時(shí)間為180分鐘.濟(jì)
二、答題方式
答題方式為閉卷、筆試.正門對面
三、試卷的內(nèi)容結(jié)構(gòu)3362 3039
數(shù)制與代碼 < 6% kaoyantj
邏輯門電路 10%~15% 112室
邏輯代數(shù) 14%~18% 業(yè)
組合邏輯電路 15%~20% 正門
觸發(fā)器 10%~15% 021-
時(shí)序邏輯電路 15%~20% 200092
脈沖波形的產(chǎn)生與變換 8%~12% 共
數(shù)字系統(tǒng)設(shè)計(jì)基礎(chǔ) 6%~10%kaoyantj
數(shù)模與模數(shù)轉(zhuǎn)換 <6% 正門對面
RAM與ROM的結(jié)構(gòu)與原理 <6%
四、試卷的題型結(jié)構(gòu)
單項(xiàng)選擇題：
填空題
分析計(jì)算題
設(shè)計(jì)題路
第二部分 考察的知識及范圍
1、邏輯代數(shù)
邏輯代數(shù)的基本定律、邏輯代數(shù)的基本規(guī)則、邏輯代數(shù)的常用公式、最小項(xiàng)和標(biāo)準(zhǔn)與或式、最大項(xiàng)和標(biāo)準(zhǔn)或與式、邏輯函數(shù)的最簡形式、邏輯函數(shù)的公式化簡法、卡諾圖、用卡諾圖表示邏輯函數(shù)、用卡諾圖化簡邏輯函數(shù)、具有隨意項(xiàng)的邏輯函數(shù)化簡、引入變量真值表和卡諾圖
2、邏輯門電路
半導(dǎo)體二極管的開關(guān)特性、半導(dǎo)體三極管的開關(guān)特性、三極管非門、二極管與門、二極管或門、TTL與非門、TTL與非門的電氣特性、其他類型TTL門電路、TTL電路的改進(jìn)、NMOS門電路、CMOS門電路、CMOS門電路的特點(diǎn)、CMOS三態(tài)門和傳輸門
3、組合邏輯電路
組合邏輯電路分析、普通編碼器、優(yōu)先編碼器、二進(jìn)制譯碼器、碼制變換譯碼器、顯示譯碼器、數(shù)據(jù)分配器和數(shù)據(jù)選擇器、數(shù)值比較器、半加器、全加器、超前進(jìn)位加法器、競爭與冒險(xiǎn)的產(chǎn)生、競爭冒險(xiǎn)的分類與判別、消除冒險(xiǎn)現(xiàn)象的方法
4、觸發(fā)器
與非門基本RS觸發(fā)器、時(shí)鐘(同步)RS觸發(fā)器、時(shí)鐘(同步)D觸發(fā)器、時(shí)鐘(同步)JK觸發(fā)器、時(shí)鐘(同步)觸發(fā)器的空翻、主從JK觸發(fā)器、維持阻塞結(jié)構(gòu)正邊沿觸發(fā)器、利用傳輸延遲時(shí)間的負(fù)邊沿觸發(fā)器、觸發(fā)器的狀態(tài)圖和激勵(lì)表、各種觸發(fā)器間的轉(zhuǎn)換
5、時(shí)序邏輯電路
時(shí)序邏輯電路的分析方法、同步計(jì)數(shù)器、異步二進(jìn)制計(jì)數(shù)器、BCD碼異步遞增計(jì)數(shù)器、多功能集成寄存器
6、半導(dǎo)體存儲器的結(jié)構(gòu)與原理
RAM的存儲單元、RAM的結(jié)構(gòu)、RAM的擴(kuò)展、ROM的構(gòu)成和工作原理、ROM的種類
數(shù)字系統(tǒng)設(shè)計(jì)基礎(chǔ)
7、脈沖波形的產(chǎn)生與整形
555電路結(jié)構(gòu)和功能、施密特觸發(fā)器及特點(diǎn)和應(yīng)用、單穩(wěn)態(tài)電路工作原理及應(yīng)用、多諧振蕩器工作原理及應(yīng)用
8、數(shù)模與模數(shù)轉(zhuǎn)換
轉(zhuǎn)換關(guān)系及數(shù)字編碼、D/A轉(zhuǎn)換基本原理、權(quán)電阻DAC、R-2R梯形及倒梯形DAC、A/D轉(zhuǎn)換原理、直接式ADC、間接式ADC
來源：南京信息工程大學(xué)
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